TSMC、「2ナノ半導体」試作を開始　アップル社のiPhone 17に利用可能か？

台湾の半導体大手、台湾積体電路製造（TSMC）は今週、2ナノ（ナノは10億分の1）メートルプロセスの試作を開始しました。同時に、TSMCの最大顧客であるアップル（Apple）社は2025年に「2ナノ半導体」での初回大型注文を確保し、それをiPhone 17に利用する見込みです。

 

さらに、TSMCは次世代の3D先進封止プラットフォームSoICを開発し、それがアップル社の新しいM5チップに採用される予定です。

 

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TSMC、「2ナノ」試作を行う予定

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報道によると、TSMCは第二四半期初に2ナノメートルのテスト、生産、および部品設備の設置を完了し、新竹の寶山に新しいウエハ工場を建設して試作を行う予定です。

報道によれば、このプロセスは3ナノメートルに比べて、同じ消費電力で10%から15%の速度向上、または同じ速度で25%から30%の電力消費削減が見込まれています。工商時報によると、関連する設備は第二四半期初に工場に導入され、試作に向けた準備が整いました。

 

TSMCはSoC（システムオンチップ）の設計がますます複雑化する中、将来的に12インチウエハーに1つのチップしか配置できなくなる可能性があり、これによりウエハの良率と生産能力に大きな挑戦が生じます。

 

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「2ナノ半導体」、iPhone 17に採用可能か？

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最近、市場はTSMCが新竹寶山のウエハ工場で2ナノメートルプロセスの試作を開始するというニュースで沸いています。この進展は半導体製造技術のさらなる飛躍を象徴しています。

 

同時に、AppleがTSMCの2025年初めの2ナノメートルプロセスの主要顧客になるとの噂もあります。

 

ただし、iPhone 17が2ナノメートルプロセスを採用するかどうかについては専門家から疑問の声も上がっています。半導体業界の専門家は、「2ナノ半導体は2025年末まで量産される可能性があるため、iPhone 17は引き続き3ナノ半導体を採用する可能性が高い」と述べています。

 

2ナノメートル技術は、おそらくiPhone 18で初めて採用される見込みです。

 

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TSMCの次世代封止技術であるSoICも話題に

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さらに、TSMCの次世代封止技術であるSoICも注目を集めています。これは高密度3Dチップ積層技術であり、Chip on Wafer（CoW）方式を通じて異なるサイズ、機能、およびノードのチップを直接積層し、パフォーマンスを向上させ、パッケージングサイズを小さくすることができます。

この技術は10ナノメートル以下の先進プロセスに適用され、Appleの新しいM5チップの生産にも計画されており、2026年には生産能力が数倍に増加する予定です。

 

SoCの設計がますます複雑化する中、一つのウエハに集積される機能が増えていく課題が予想されます。そのため、TSMCを含む業界のリーダーは、SoIC技術を加速させ、立体積層ソリューションを通じて増加するトランジスタ数、インターフェース要件、および転送品質基準に対応し、コストを抑えることを目指しています。

 

SoIC技術の初期採用者として、AMDのMI300チップが挙げられます。このチップは現在良率向上の初期段階にあり、その技術の広範な適用が業界の多くの大手メーカーの関心を引いています。TSMCは、大手顧客の需要に応えるため、SoICの生産能力を2023年に少なくとも倍増させる予定です。

 

TSMCのSoIC技術開発は市場から高い関心を集めており、各大手顧客が興味を示しています。TSMCは今後、少なくとも生産能力を倍増させる予定であり、2026年までにその能力を数倍に増やす計画です。

 

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まとめ

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総括すると、TSMCの2ナノメートルプロセスとSoIC封止技術の両方における進展は、半導体製造業の発展を推進し、Appleを含むトップテクノロジーカンパニーに強力な技術支援を提供することになります。これにより、将来の電子製品の性能向上が期待されます。

 

アップル（Apple）社はTSMCの2025年初めの2ナノメートルプロセスの生産能力を獲得し、同時にSoIC技術もAppleの新世代M5チップに導入され、量産が始まる見込みです。2026年までには、SoICの生産能力が数倍以上に拡大する予定です。

 

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